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校招崗位

? 模擬版圖設計工程師

(上海/西安)

7K~18K

? 數字后端工程師(PR/DFT)

(上海/西安)

7K~18K

簡歷投遞郵箱:jimmy.kudo@wallchip.com

簡歷投遞主題:崗位+姓名

面試流程:投簡歷→面試→錄用/實習


芯片設計數字后端設計工程師

崗位職責

在先進28納米/16納米/10納米/7納米工藝節點上設計SOC芯片。主要負責從網表到GDSII版圖設計,諸如布圖,布局布線,行為綜合,時序驗證,可測性設計,可制造性設計,時鐘設計,電路特性設計,DRC/LVS,IP模塊設計,模擬電路設計,封裝基板設計,標準單元庫/Memory單元庫版圖設計,信號完整性功耗完整性仿真。

崗位要求

1.電子信息與工程,微電子,計算機科學與技術,電路與系統工程專業應屆本科畢業生,碩士畢 業生優先。大三/大四實習生;

2.有一年相關工作或實習經驗者優先;

3.掌握理解基本模擬電路設計或數字電路設計;

4.熟悉spice,Verilog/VHDL語言,版圖設計工具;

5.熟悉C,Perl,Tcl,Python等編程語言;

6.熟悉Synopsys/Cadence/Mentor公司的EDA工具者優先;

7.熟練英文書寫和口語技能;

8.有團隊合作精神。


模擬版圖工程師

崗位職責

在先進28納米/16納米/10納米/7納米工藝節點上設計SOC芯片。主要負責從網表到GDSII版圖設計,諸如布圖,布局布線,行為綜合,時序驗證,可測性設計,可制造性設計,時鐘設計,電路特性設計,DRC/LVS,IP模塊設計,模擬電路設計,封裝基板設計,標準單元庫/Memory單元庫版圖設計,信號完整性功耗完整性仿真。

崗位要求

1.電子信息與工程,微電子,計算機科學與技術,電路與系統工程專業應屆本科畢業生,碩士畢 業生優先。大三/大四實習生;

2.有一年相關工作或實習經驗者優先;

3.掌握理解基本模擬電路設計或數字電路設計;

4.熟悉spice,Verilog/VHDL語言,版圖設計工具;

5.熟悉C,Perl,Tcl,Python等編程語言;

6.熟悉Synopsys/Cadence/Mentor公司的EDA工具者優先;

7.熟練英文書寫和口語技能;

8.有團隊合作精神。


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